车规电容·国产替代 | 上海永铭四大领域电容器方案亮相<span style='color:red'>PC</span>IM2026-深圳国际电力元件、可再生能源管理展览会暨研讨会:新能源汽车电子篇
  一、前言  上海永铭电子将于8月26日至28日参加2026深圳国际电力元件、可再生能源管理展览会暨研讨会,进驻深圳国际会展中心(宝安新馆)16号馆D28 。永铭将在现场全方面展示四大核心领域【新能源汽车电子、AI服务器、无人机&机器人(电机驱动)、能源与工业电力】电容解决方案,探讨如何以核心元器件技术创新推动产业升级。  在新能源汽车电子领域,永铭电容解决方案覆盖热管理系统、安全系统、电驱电控、车载碰撞模块CPM、智能座舱、驻车锂电BMS等核心应用,全产品线通过AEC-Q200认证,从电驱到座舱,从热管理到安全系统,永铭为整车厂和Tier1供应商提供PIN-TO-PIN替代进口品牌的国产方案选择。  二、全车载场景覆盖·车规级认证:永铭新能源汽车电子电容方案  | 热管理系统·电子水泵:固液混合电容,150℃宽温+30G抗震  车载电子水泵在运行时,面临高振动、宽温冲击、大电流纹波的多重考验。永铭针对电子水泵运行时的复杂工况,有VHT/VHU/VHR三个系列固液混合电容方案应对,其核心优势在于:  · 高抗震结构设计:标准品满足10G振动,加座板可达30G。  · 双电解质技术:VHT/VHU/VHR三大系列共同构成从105℃、135℃到150℃的全温区矩阵。  · 超低ESR与宽频稳定:在100kHz条件下ESR均可低至0.020Ω,能承受高达2800mA(@125℃)的大纹波电流,确保输出电流平滑稳定。  实际案例:在某新能源汽车电子水泵应用中,选型VHU 25V 470μF 10×10.5固液混合电容方案,成功消除冷启动异响并顺利通过10G振动测试,在-55℃~125℃全温区范围内电性能波动极小,实现对标日系品牌的国产替代。  【部分核心规格推荐】  | CPM碰撞模块:双电层超级电容方案,替代电池,毫秒级响应  新能源车电子门锁失灵等紧急事件的发生,衍生出CPM碰撞电源模块的新应用,同时提出了瞬时启动的应用要求。永铭SDH系列超容替代电池,完全覆盖碰撞断电、涉水短路、-40℃极寒弱电等极限工况,将“储能参数”转化为“碰撞/掉电后的动作确定性”,100%保障事故后至少一次可靠应急解锁,杜绝安全锁死风险,为车身安全冗余提供硬核级保障。  · 低ESR:瞬时大电流稳定输出,瞬间提供数百安培电流,确保碰撞后门锁可靠动作;低漏电保证长期待机后可用,一致性与追溯保证多串模块可靠落地。  · 宽温域性能:-40℃~85℃环境下容量衰减<10%,ESR变化<15%,全生命周期免维护。  · 超长寿命:循环寿命超50万次,耐高温85℃@1000小时;可提供5/10/15年寿命方案  【部分核心规格推荐】  | 安全气囊ECU:铝电解电容LK系列解决方案  安全气囊ECU对低温放电、高温寿命及耐久性提出了高要求。永铭LK系列液态引线型铝电解电容,通过AEC-Q200,可直接对标替代NCC LBG/LBV系列。  · 低温高倍率放电:-40℃/120Hz下永铭LK系列的ESR低至97.72mΩ(优于NCC LBV的106.93mΩ)  · 高温长寿命:105℃/3000h容量衰减2.71%,性能比肩日系同行,可实现直接替代  · 耐久性:10万次循环寿命,确保电容能在频繁的自检中维持性能稳定。  【部分核心规格推荐】  | 电驱电控:薄膜电容方案,从容应对800V高压系统挑战  产品采用改性金属化聚丙烯薄膜与多极耳结构,超低ESR完美适配SiC高频电路,有效抑制电压尖峰、降低整机功耗。搭载自愈防护技术,使用安全可靠。  · 无极性设计寿命超10万小时,全密封环氧封装确保车载恶劣环境稳定运行。  · 实际案例:8颗MDP电容替代22颗铝电解电容,PCB面积减少50%以上,母线电压峰值降低40%,系统峰值效率提升约1.5%。  三、优势电容产品展出,诚邀莅临共探方案  无论您正面临热管理振动失效的困扰,还是寻求安全系统国产化替代的最优解,我们都期待您莅临现场,锁定永铭展台(16号馆 D28),探讨电容器技术为新能源汽车带来的无限可能!  电容应用,有困难找永铭。
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发布时间:2026-08-03 10:05 阅读量:209 继续阅读>>
瑞萨电子推出的第三代MRDIMM将DDR5内存性能提升至16,000MT/s,赋能下一代AI与H<span style='color:red'>PC</span>应用
  全球半导体解决方案供应商瑞萨电子(TSE:6723)今日宣布,推出其第三代(Gen3)DDR5多路复用双列直插内存模块(MRDIMM)芯片组解决方案,可实现高达16,000兆次传输/秒(MT/s)速率的服务器级MRDIMM。该系列解决方案专为应对人工智能(AI)数据中心、云基础设施及加速计算工作负载等场景,对更高内存带宽日益增长的需求而设计。  瑞萨将于2026年8月4日至6日在美国加利福尼亚州圣克拉拉举行的FMS 2026(存储与内存未来大会)上展示第三代MRDIMM内存接口组件(展位号#807),包括:  支持下一代MRDIMM性能的第三代多路复用寄存时钟驱动器(MRCD,RRG5013x)  多路复用数据缓冲器(MDB,RRG5103x)  随着AI模型规模持续扩大、计算工作负载的数据密集度不断攀升,系统架构师在确保与现有服务器平台兼容的同时,面临着提供更高内存带宽的严峻挑战。瑞萨第三代MRDIMM解决方案在沿用现有DDR5基础设施的基础上,较第二代方案可实现25%的内存带宽提升。这意味着服务器平台无需进行颠覆性的架构变更,即可释放更强的性能。  瑞萨持续提供经现场验证且可量产的MRDIMM平台,涵盖:  MRCD  MDB  电源管理IC(PMIC)  串行存在检测(SPD)集线器  温度传感器  这一平台化策略使客户能够在跨代升级中灵活扩展MRDIMM性能,同时保持设计的连续性并加速产品部署。  第三代MRDIMM基于成熟的第二代产品架构,在扩展性能的同时保留了标准DIMM的外形尺寸和系统兼容性。此外,第三代产品还增强了系统的可视性与稳健性,包括设备均衡自训练模式(DESTM)的质量指示状态,该功能使用户能够微调时序和接收端均衡训练,从而最大化裕量。  除性能提升外,瑞萨第三代MRDIMM解决方案在设计时充分考虑了系统级能效,旨在帮助客户在日益增长的带宽需求与系统层面的散热设计及功耗限制之间取得平衡。详细的功耗对比数据将在随附的产品文档中提供。  Amit Goel, Corporate Vice President, Compute and Enterprise AI Platform Solutions Engineering, AMD表示:  AMD长期以来一直致力于支持开放且基于标准的技术,这些技术推动了数据中心的创新,并随着AI和HPC工作负载的不断演进而提供了更高的灵活性。MRDIMM和瑞萨芯片组等下一代内存形态的创新,对于助力行业实现更高带宽、更高效率以及持续的平台可扩展性至关重要。  Sameer Kuppahalli, Vice President and General Manager, Memory Interface Division at Renesas表示:  AI训练和推理工作负载正在从根本上重塑数据中心基础设施的系统内存需求,为满足这些工作负载对内存容量及吞吐量的巨大需求,瑞萨始终走在行业前沿,推出了第三代MRDIMM芯片组组件。我们的客户正采用瑞萨完整的芯片组组件,持续突破内存吞吐量和容量的边界。  瑞萨正与领先的CPU及平台合作伙伴紧密协作,推动第三代MRDIMM在未来服务器平台中的应用落地,进一步巩固MRDIMM作为下一代AI与云基础设施可扩展内存架构的地位。
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发布时间:2026-07-31 13:33 阅读量:282 继续阅读>>
杰华特丨降本增效!8口PoE芯片新标杆JWH72978,单芯片实现240W满载免风扇,<span style='color:red'>PC</span>B面积节省40%+
  硬核集成|  单颗芯片包揽8路PoE,告别堆料设计  JWH72978是专为中小功率PoE设备打造的高集成、高性价比PSE解决方案,能有效革新传统分立架构,把复杂电路全部集成进一颗小封装芯片,大幅简化硬件开发流程。  01  核心集成优势  全内置功率器件:集成8通道低阻高压MOS,单通道RdsON仅300mΩ,线路损耗低,满载温升表现良好,省去外置功率管配套设计  免外挂采样电阻:每通道搭载无损高精度电流检测,无需外接采样器件,BOM清单大幅精简  节省片式多层陶瓷电容器(MLCC):JWH72978仅需配置一颗1uf MLCC于VCC5V pin,八通道输出与48V输入之间的输出电容容值可选用容值≤0.1μF规格,极简成本下,可以省去输出电容;而传统分立方案需搭配大量大尺寸封装的分立功率MOS、大封装sense电阻和高耐压的MLCC,MCU电源pin的外围同样需搭配多颗MLCC,选用JWH72978可显著缩减MLCC物料数量,节约BOM成本。  小巧封装省空间:采用QFN6×6-28紧凑型封装,对比传统MCU+多分立器件方案,PCB布局面积可节省40%以上  大幅降低失效率:单芯片替代多颗分立元器件,减少焊点与故障节点,设备稳定性、量产良率双重提升  在协议适配方面,芯片90%兼容IEEE802.3af/at标准,支持上电自动PD设备侦测、负载断线检测、硬件限流,满足多数安防、网络设备的供电需求。  02  引脚一键切换功率模式  芯片无硬件分级限制,仅通过L1引脚上下拉即可快速切换功率档位,单颗芯片可适配两类供电产品:  L1上拉:单口30W|Class4满功率at标准  L1下拉:单口15W|Class3常规af标准  多品类产品可共用一颗物料,减少备货种类,降低供应链成本。  同时搭载14bit高精度ADC,搭配400KHz高速I2C接口,可实时采集每端口电压、电流数据;I2C总线支持最多挂载2颗芯片,轻松拓展出16口PoE方案,适配多规格设备开发。  采用工业级宽温设计,-40℃~+85℃稳定运行,轻松应对户外露天、高温机房、恶劣工地等复杂场景。  JOULWATT  全链路防护,稳定耐用|  240W满载免风扇,降低运维成本  市面多数PoE设备普遍存在满载温升偏高、需额外加装散热风扇、运行噪音大、结构物料成本高、风扇易老化失效、整机使用寿命受限等问题。JWH72978经实测验证,8端口满载总功率可达240W,整机无需额外配置散热风扇,节省风扇、结构配件、装配人工、后期售后维护等多项成本。  01  搭载多层次防护机制  基础硬件防护:欠压、过压、过流、限流、过温、输出短路全方位保护  进阶专属防护:Fetbad故障保护、过功率保护、软启动保护,有效防止上电冲击损坏设备  系统长效防护:MPS保护长效在位侦测,实时监测PD设备掉线状态;I2C看门狗保护,规避总线卡死问题  强悍抗干扰能力:HBM±2kV人体静电防护、±500V机器放电防护,适配工地、户外等复杂安装场景  高压兼容设计:集成110V热插拔MOSFET,大幅提升系统抗电压冲击能力  功率MOSBV曲线  240W满载温升图  02  实用功能适配批量落地  智能功率仲裁:整机超功率时优先关闭低优先级端口,保障核心监控设备不断电  端口极速关断:短路瞬间快速保护,有效降低炸机风险  傻瓜式操作:全自动/关机双模式,上电即可工作,无需配置寄存器  双工作架构:支持无MCU独立运行、外挂MCU I2C精准管控,按需选型适配  故障主动上报:异常点位主动中断告知MCU,快速定位故障,售后检修更省心  抗误上电设计:支持多次频繁热插拔,不会出现误启动,全面保护后级PD设备  JOULWATT  方案对标|  全方位突破传统MCU分立方案  相较于行业通用的「MCU+分立MOS」传统方案,JWH72978集成方案实现了成本、体积、性能、开发效率四维全面升级。  传统方案核心痛点:  元器件数量多、贴片成本高、PCB空间浪费严重,软硬件联调周期长,对工程师技术要求高,且量产一致性差、失效率偏高,后期售后成本高昂。  JWH72978落地核心优势:  单芯片替代整套分立方案,缩短新品研发周期、降低BOM物料成本、PCB布线面积可缩减40%以上,同步提升量产良率,是现阶段PoE设备优化成本、提升生产效率的优选方案。  相较于PSE6*6mm尺寸,传统MCU方案摆件尺寸示意图  JOULWATT  全域落地|  已量产适配三大核心场景  JWH72978定向适配安防、网络设备、供电配件三大主流赛道,现阶段已完成多客户批量导入,适配范围广泛:  安防设备:NVR网络硬盘录像机、DVR数字录像机内置PoE供电模块  网络设备:8口/16口PoE交换机、企业级路由供电系统  供电配件:大功率PoE中跨注入器  依托成熟PoE供电技术,一根网线即可同时传输数据+供电,无需单独铺设电源线。网线覆盖区域均可布设监控摄像头,有效降低50%的现场施工成本,提升项目落地效率。  目标市场精准破局,赋能PoE行业降本升级  当前PoE设备行业市场竞争激烈,单纯依靠低价竞争难以形成长期优势,优化硬件方案、控制物料成本、提升设备稳定性才是企业核心竞争力。  JWH72978创新采用单芯片一体化架构,替代传统MCU搭配多组分立MOS的复杂电路;内置功率MOS、高精度ADC与全套保护电路,可完整覆盖PD识别、功率调配、短路防护全链路管控,既能缩减PCB布线空间、MLCC数量以及BOM成本,优化整机散热表现,还可将设备整机返修率由8000PPM降至5ppm左右。  该方案精准契合厂商对高性价比、简易调试、高稳定运行的需求,妥善化解分立器件批次一致性差、售后维修成本偏高的行业痛点,产品落地后快速通过多家客户验证并实现批量量产。  未来,杰华特将持续深耕智能电源管理技术,以硬核芯片实力,为安防、网络通信行业赋能,助力更多企业打造高性价比、高稳定性的标杆级产品。
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发布时间:2026-07-03 09:36 阅读量:404 继续阅读>>
杭晶电子丨邀请函  泰国NE<span style='color:red'>PC</span>ON元器件展  连接东盟·智造未来
上海永铭丨<span style='color:red'>PC</span>B空间极度受限?永铭φ7/φ12/φ13/φ14.5mm非常规直径铝电解电容——无需改板,兼顾高纹波、长寿命与低成本
  当小型化设计卡在了电容尺寸上  当前,工业控制、车载设备、消费类电源等产品设计,普遍追求更高功率密度与更小体积,这要求内部元器件也必须同步小型化。然而,当标准尺寸的电容无法适配时,研发团队往往陷入困境。  对客户而言,一次尺寸“卡壳”可能意味着:改板流片多花数万元研发成本,延期上市错失销售良机,或因产品体积过大而丧失价格竞争力。昂贵的从来不是那几元钱的电容,而是研发改模的投入、丢失订单的损失,以及找小厂定制非标品带来的返修风险。  01 小型化趋势下,电容尺寸成了卡脖子的问题  产品小型化是所有行业的共同趋势,超薄电源适配器、车载OBC(车载充电机)、紧凑型电源等产品,PCB 空间被极度压缩,常规标准电容尺寸(如φ6.3/φ8/φ10/φ12.5mm)往往无法适配预留位置,传统方案普遍存在各种难以解决的问题:  1、调整适配PCB的电容:需要重新改版流片,拉长研发周期,增加改模成本,甚至错过产品上市窗口,给企业带来直接订单损失;  2、改用固态/聚合物电容替代:尺寸可以满足要求,但成本比液态铝电解高30% 以上,给整机带来难以承受的成本压力;  3、找小众厂商定制非标尺寸:多数小厂没有成熟的非标量产工艺,电容一致性差,纹波电流能力达不到设计要求,批量应用容易出现早期失效,后期返修成本居高不下,还影响品牌口碑。  问题的本质在于:物理空间限制要求更小直径,电气性能要求在有限直径内保持足够容量、耐压与低ESR(等效串联电阻),常规量产工艺无法实现小直径下的性能平衡。  02 永铭解决方案:用技术,减少损失、创造收益  针对PCB空间极度紧凑的设计场景,永铭通过三项核心技术,针对性解决小直径下的尺寸与性能平衡问题,特别推出φ7/φ12/φ13/φ14.5 mm非常规直径的液态铝电解电容,帮助客户无需修改PCB设计、不增加额外成本,轻松解决尺寸适配的难题。  上述非常规直径规格已全面导入永铭LKM、LKG、LKF、KCM系列,从低压到高压全场景覆盖,适配各类客户的设计需求。  【部分优势规格推荐】  03 应用效果验证:数据说明价值  该直径产品已在多个超薄电源等项目中批量应用,验证结果如下:  尺寸适配:成功嵌入客户预留的狭小空间,无需更改 PCB 布局即可完成整机装配,帮助客户顺利推出符合设计要求的小型化产品;  寿命验证:据公开测试数据,在105℃环境下,负载寿命达到行业最高标准,满足工业、车载场景的长期使用要求;  性能对比:φ7/φ12/φ13/φ14.5mm 等规格产品,同等电压下纹波电流承受能力比常规电容提升15%以上,温升控制表现更优。  04 为什么更多的人选择比常规尺寸贵的非标电容  很多客户会问:非标电容是不是比标准品贵?其实算一笔全生命周期的账,结论就很清晰:  非标电容单价比标准品仅高几毛钱,可以避免了几万元的PCB改模费用,节省了延期上市带来的订单损失,比更换固态/聚合物电容节省30%以上的物料成本;稳定的量产工艺保障产品一致性,降低批量失效的返修风险,减少售后成本。  对于客户而言,我们卖的不只是一颗非标尺寸的电容,而是一次几元钱的投入,帮助你抓住小型化产品的市场机会,避免潜在的大额损失,全生命周期成本(TCO)反而更低。  05 场景化Q&A  Q1:PCB空间有限,标准尺寸电容装不下,有什么合适的电容解决方案?  A:永铭 LKM/LKG 等系列φ7/φ12/φ13/φ14.5mm 非常规直径液态铝电解,可直接适配预留空间,同时满足纹波电流和寿命要求,无需改板即可使用。  Q2:永铭的非标电容最小起订量高吗?交货周期稳定吗?  A:永铭具备稳定的非标尺寸量产能力,交货周期与常规标准品基本一致,针对不同应用场景提供灵活的起订量方案,保障客户供应链稳定。  Q3:和常规小直径电容相比,非标准直径的电容会不会在纹波电流、寿命方面性能缩水?  A:永铭非标直径电容(φ7/φ12/φ13/φ14.5mm)通过强化电解液配方和优化电极箔腐蚀工艺,在缩小直径的同时保障电气性能,据公开测试数据,同等电压下纹波电流承受能力比常规竞品提升 15% 以上,105℃环境寿命满足行业最高标准。  结语  永铭非常规尺寸小直径(φ7/φ12/φ13/φ14.5mm)液态铝电解电容,解决的不只是电容尺寸装不下的问题,更是帮助客户缩短研发周期、降低综合成本、抓住小型化市场机会的完整解决方案。帮助客户在紧凑空间内实现性能与成本的平衡,获得更低的全生命周期成本、更高的产品可靠性,以及更具竞争力的小型化产品优势。  如果您当前的设计正遇到电容尺寸不适配,市面上又找不到更小直径的电容,欢迎联系永铭官网客服(www.ymin.com),索取规格书或申请样品,永铭FAE团队将为您提供针对性的选型支持。
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发布时间:2026-06-15 09:51 阅读量:528 继续阅读>>
直击<span style='color:red'>PC</span>IM Europe 2026|维安产品方案全揭秘
  前言  作为全球最大的功率半导体展会, PCIM Europe 2026 (德国纽伦堡电力电子系统及元器件展览会)于当地时间6月9日至11日在德国纽伦堡展览中心拉开帷幕。本届展会覆盖从半导体材料到能源管理系统的全链条,聚焦行业对功率密度和信号频率的升级需求。  维安(WAYON)如约登陆德国纽伦堡参展,携电路保护&功率控制两大板块全系列产品及解决方案亮相。其中,多款产品及配套方案紧贴AI应用需求,专为AI服务器、数据中心等基础设施提供高可靠支持,携手全球伙伴共拓算力产业新机遇。  1  两大产品板块,  深度适配算力、储能、  工业与汽车场景  本次展会,维安集中展示迭代升级的核心产品,产品具备小型化、高可靠、低损耗等特性,可全面满足终端设备在系统保护和高功率密度等方面的严苛需求。  电路保护  精准分级防护,  为终端设备构筑安全基石  车规级直流电机保护器件(GP/LA/LP型)、TVS、ESD、PPTC、E-Fuse、智能熔断器等系列产品,具备过压保护、过流保护、短路保护、浪涌抑制、故障自恢复及精准熔断等核心防护能力,可广泛为汽车、数据中心、供配电系统及储能系统构建从端口到核心电路的全方面安全屏障。  功率控制  高功率密度设计,升级效率上限;  集成化创新,赋能系统价值跃升  涵盖 C4 代超结 MOSFET、超薄高功率密度 MOSFET、1000V 超高压 MOSFET,依托先进工艺实现高耐压、低内阻、高功率密度,充分满足大功率供电设备的高效运行需求,有效提升整机能效。混合信号IC产品同步展出,支持灵活定制化开发服务。智能保护IC、电源管理IC、信号链IC等产品,以高集成、低功耗、强抗干扰等特性,适配各类供配电系统及智能监控模块,兼顾标准化应用与深度定制需求。  2  聚焦 AI & 数据中心定制化解决方案  面向 AI 产业与大型数据中心,我们推出整套电力电子配套方案:  数据中心供电  器件组合满足机房大功率、7×24 小时连续运行需求,低能耗、强稳定。  AI 服务器 & 算力设备  采用小型化高性能产品,适配高密度算力硬件,助力设备高效运行。  机房智能管控  电源+信号管理芯片,助力机房配电、监控系统智能化升级。  AI服务器典型结构  3  相约纽伦堡,共启合作新篇  PCIM Europe是连接全球功率电子产业的核心桥梁,也是国产自主产品走向世界的重要窗口。展会期间,维安(WAYON)展台吸引了众多海内外专业观众驻足交流。大家尤其关注我们面向三大领域的整体配套方案。  在AI领域,小型化器件在高密度算力场景下的散热与效率表现、7x24小时连续运行的可靠性验证数据;在新能源领域,光伏逆变、储能系统中功率转换效率与长期稳定性;在汽车电子领域,车规级产品耐高温、抗震动性及功能安全认证进展…现场技术团队与来访客户面对面探讨了实际应用痛点,分享国产化创新经验,并就功率电子的高频化、集成化、车规级趋势交换了看法。  未来,维安(WAYON)将继续以技术创新为驱动,依托稳定可靠的交付能力、持续迭代的产品与定制化服务,携手全球行业同仁,共探功率电子趋势,对接多元化合作需求,持续为全球客户创造价值。
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发布时间:2026-06-12 09:55 阅读量:787 继续阅读>>
芯跃未来 | 核芯互联 CLG21012 重磅发布 国产高性能时钟发生器全面兼容 <span style='color:red'>PC</span>Ie 7.0
  在数据中心、AI 算力集群、高端服务器对时钟精度要求日益严苛的今天,核芯互联正式推出新一代高性能可编程时钟发生器——CLG21012。该产品 Pin-to-Pin 兼容业界标杆 Renesas RC21012,并在核心性能指标上实现全面超越,率先实现 PCIe Gen7 时钟兼容性,为下一代高速互连基础设施提供强劲"芯"动力。  一、产品定位:国产替代,性能跃升  CLG21012 是一款 12 通道输出高性能可编程时钟发生器,频率覆盖 1kHz 至 650MHz,支持 LVDS、LP-HCSL、LVCMOS 等多种输出格式。产品面向高性能计算(HPC)、数据中心加速器、企业级存储、交换机与路由器等关键应用场景,旨在为国内通信与计算产业提供自主可控、性能卓越的时钟解决方案。  更重要的是,CLG21012 与 Renesas RC21012 实现硬件级 Pin-to-Pin 兼容,用户无需修改 PCB 设计即可无缝替换,大大降低了国产导入的门槛和风险。  二、核心突破:PCIe Gen7 就绪  PCIe 7.0 作为下一代高速接口标准,对参考时钟的 RMS 相位抖动提出了极为严苛的要求——Common Clock 模式下需低于 67fs。这对时钟发生器的设计提出了前所未有的挑战。  核芯互联 CLG21012 在展频(SSC)条件下实测 PCIe Gen7 抖动表现如下:  实测数据显示,CLG21012 在最优配置下 PCIe Gen7 抖动低至 63.95fs,充分满足 PCIe 7.0 的 67fs 严苛要求,为下一代 128GT/s 高速互连奠定了坚实的时钟基础。  三、性能实测:抖动降低最多 60%,功耗降低最多 57%  核芯互联对 CLG21012 与 RC21012 进行了全面对标测试,覆盖多种晶振频率、输出格式和输出频率组合。测试结果令人振奋——CLG21012 在抖动性能和功耗控制上全面领先。  3.1 LP-HCSL RMS 相位抖动对比(25MHz 晶振)  3.2 LVDS RMS 相位抖动对比(25MHz 晶振)—— 新增测试  最新测试报告新增了对 LVDS 输出格式的全频段抖动测试。CLG21012 在 LVDS 模式下同样展现出远超 RC21012 的低抖动性能:  3.3 更多晶振选择,更低抖动表现  CLG21012 支持 25MHz、39.0625MHz、50MHz、78.125MHz 等多种晶振输入频率,并在每种配置下均展现出优异的低抖动特性。以下为 LP-HCSL 模式下的实测数据:  特别值得一提的是,CLG21012 在78.125MHz 晶振 X2 倍频模式下,156.25MHz 输出 RMS 抖动低至96.5fs,312.5MHz 输出低至82.8fs,均为业界顶尖水平,为高阶通信和计算应用提供了极致的时钟纯净度。  3.4 输出波形实测  CLG21012 在 LP-HCSL 和 LVDS 两种主要输出格式下均表现出极佳的信号完整性,边沿陡峭、过冲小、占空比精准。  ▲ LP-HCSL 100MHz 输出波形实测  Vamp = 1.53V | Duty Cycle = 50.2%  ▲ LVDS 100MHz 输出波形实测  Vamp = 826mV | Duty Cycle = 50.1%  3.5 实测相噪曲线 —— CLG21012 vs RC21012 直观对比25MHz 晶振 | LP-HCSL 156.25MHz▲ CLG21012 — RMS Jitter: 154.4 fs  ▲ RC21012 — RMS Jitter: 364.6 fs  25MHz 晶振 | LVDS 156.25MHz▲ CLG21012 — RMS Jitter: 156.1 fs  ▲ RC21012 — RMS Jitter: 361.9 fs  从相噪曲线可以清晰看出,CLG21012(蓝色曲线)在整个频偏范围内均显著优于 RC21012,尤其是在 1kHz~1MHz 的关键频段内,相噪底更低、杂散更少,直接转化为更低的 RMS 抖动。  不同晶振配置下 CLG21012 相噪表现  ▲ 50MHz 晶振 | LP-HCSL 156.25MHz — RMS Jitter: 127.7 fs▲ 78.125M X2 模式 | 156.25MHz — RMS Jitter: 96.5 fs  ▲ 78.125M X2 模式 | 312.5MHz — RMS Jitter: 82.8 fs  3.6 功耗对比:核心功耗降低 57%  在追求高性能的同时,CLG21012 在功耗控制上同样表现出色:  核心功耗从 174mA 降至 74mA,降幅高达 57%。在大规模数据中心部署中,这意味着数以千计的服务器节点累计节省的功耗将极为可观,直接转化为运营成本的降低和碳排放的减少。  四、SSC 展频功能实测  PCIe 规范要求参考时钟支持展频(Spread Spectrum Clocking, SSC)以降低 EMI。CLG21012 支持中心展频和下展频两种模式,展频深度可编程。最新测试报告对 SSC 功能进行了全面验证:  调制频率:31.5KHz / 33KHz 可选  展频深度:-0.25% / -0.5% Down Spread  频率精度:满足 PCIe Gen7 对展频时钟的精度要求  ▲ CLG21012 SSC 展频实测频谱(31.5KHz 调制 / -0.5% Down Spread)  实测结果表明,CLG21012 的 SSC 功能各项参数均符合 PCIe 规范要求,可有效降低高速时钟带来的 EMI 干扰,同时保持优异的抖动性能。  五、关键特性一览  六、应用场景  凭借卓越的低抖动性能和灵活的输出配置,CLG21012 可广泛应用于以下领域:  高性能计算(HPC)——为多路 CPU/GPU 互联提供极低抖动的参考时钟,保障高速 SerDes 链路的信号完整性。  数据中心与 AI 加速器——满足 PCIe Gen7 时钟要求,为 128GT/s 的 CXL 和 PCIe 互连提供可靠时钟源,降低误码率,提升训练效率。  企业级存储——为 NVMe SSD 控制器、RAID 卡等提供高精度时钟,确保高速数据传输的稳定可靠。  交换机与路由器——支持 100G/400G/800G 以太网 PHY 时钟需求,助力网络基础设施带宽升级。  工业控制——宽温工作范围和 robust 设计确保在严苛工业环境下的长期稳定运行。  七、国产替代,供应保障  在全球半导体供应链波动的大背景下,核芯互联 CLG21012 的推出为国内通信设备厂商、服务器制造商和数据中心运营商提供了一个高性能、高可靠性的国产时钟解决方案。Pin-to-Pin 兼容设计确保了用户可以在不改动现有硬件平台的情况下快速完成导入验证,大幅缩短产品上市周期。  同时,本土供应链的优势使得 CLG21012 在交货周期、技术支持和成本控制方面具备更强的竞争力,帮助客户在激烈的市场竞争中抢占先机。  八、结语  核芯互联 CLG21012 的发布,标志着国产高性能时钟发生器在技术上达到了国际领先水平。更低的抖动、更低的功耗、PCIe Gen7 就绪——这三大核心优势使其成为下一代高速计算与通信系统的理想时钟伙伴。  我们诚邀各领域的合作伙伴联系核芯互联,获取 CLG21012 的详细技术资料和样品支持,共同开启高速互联的新篇章。
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发布时间:2026-06-09 13:35 阅读量:668 继续阅读>>
泰晶科技丨藏在<span style='color:red'>PC</span>B里的杂散电容才是隐形杀手
  做硬件开发的朋友大概率都遇到过这种糟心事:明明选了参数匹配的晶振,焊上板子却要么不起振,要么频率飘得离谱,换了好几个晶振都没用。其实很多时候,真不是晶振质量差,而是你忽略了PCB里无处不在的“隐形电容”——杂散电容。今天就来拆解这个藏在电路里的“捣蛋鬼”,聊聊它的来源、危害和驯服方法。  01 什么是杂散电容?电路里的“天然寄生者”  杂散电容(Cstray)是电路中完全无法避免的寄生参数,只要有导体、有距离、有介质,它就会悄悄形成。你可以把它理解成PCB上无数个看不见的小电容:走线和地平面之间、元器件引脚和焊盘之间、甚至两条相邻的导线之间,都会因为电场耦合产生电容效应。  在常规PCB设计中,杂散电容的典型值在2pF到5pF之间,行业里通常默认用3pF作为初始估算值。但这个数值只是“理想情况”,实际项目中它很容易突破上限,变成影响电路稳定性的“定时炸弹”。  02 负载电容的“骗局”:杂散电容是怎么拖晶振后腿的?  用过无源晶振的朋友都知道, datasheet里会明确标注一个关键参数——负载电容CL,这是晶振能工作在标称频率下的核心条件。在最常用的Pierce振荡电路中,我们通常会在晶振两侧接两个对称的外接电容C1和C2,此时实际加载在晶振上的等效负载电容,可不是简单的C1和C2串联,还得加上杂散电容的“暗中掺和”。  举个例子:如果晶振要求的负载电容是18pF,按3pF的杂散电容估算,我们会算出需要接30pF的外接电容。但如果实际杂散电容是5pF,那等效负载电容就会变成20pF,超出晶振的标称值,直接导致频率偏低,严重时甚至会让晶振无法起振。  03 哪些情况会让杂散电容“超标”?  杂散电容突破3pF其实是家常便饭,这些场景尤其要注意:  1、MCU引脚的“隐藏属性”‌:很多MCU的IO引脚标称电容是2pF,但实际批量生产中,这个数值可能会涨到4pF到7pF,直接拉高了整个电路的杂散电容基数。  2、走线越长,电容越大‌:晶振和MCU之间的走线每增加1cm,就可能带来0.2pF到1pF的额外电容。如果为了布线方便绕个大弯,杂散电容分分钟超标。  3、多层板的“双面夹击”‌:在四层及以上的PCB中,晶振信号线如果紧贴地平面或电源层,就会形成类似平行板电容的结构,耦合效应会让杂散电容大幅增加。  4、画蛇添足的设计‌:为了焊接方便把焊盘画得过大,或者把外接电容离晶振太远,都会进一步放大寄生效应,让杂散电容“越攒越多”。  04 杂散电容的“杀伤力”:对无源和有源晶振区别对待  杂散电容对不同类型的晶振,影响方式也完全不同:  无源晶振:直接动摇“根本”‌:无源晶振的频率完全依赖外部负载电容,杂散电容会直接改变等效负载电容值,轻则导致频率偏移,重则让晶振无法满足起振条件,直接“罢工”。  有源晶振:间接破坏“环境”‌:有源晶振自带振荡电路,杂散电容不会直接影响输出频率,但会干扰信号质量。比如让输出信号的抖动增大、上升沿变缓,甚至引入额外的噪声,长期下来会让系统稳定性下降,温度漂移也会变得更严重。  05 驯服杂散电容:PCB设计阶段就该动手  既然杂散电容无法消除,那我们就得想办法控制它。在PCB设计阶段做好这些细节,能有效把杂散电容控制在合理范围内:  1、贴身布局‌:晶振要尽量靠近MCU的时钟引脚,能贴多近贴多近,最短路径走线,减少走线带来的分布电容。  2、精简走线‌:晶振的时钟线要尽量短、尽量直,避免过孔,实在需要过孔也要尽量少打,每一个过孔都会增加额外的寄生电容。  3、小焊盘,短引脚‌:在保证焊接可靠性的前提下,尽量缩小晶振和外接电容的焊盘尺寸,元器件引脚也尽量剪短,减少引脚和焊盘带来的寄生效应。  4、合理参考地‌:给晶振信号线提供连续的地平面参考,但要避免信号线和地平面、电源层过于“亲密接触”,减少平行板电容效应。  5、远离干扰源‌:晶振要远离DC-DC转换器、高频时钟电路等干扰源,这些模块的电磁辐射会和杂散电容叠加,进一步恶化信号质量。  06 实战调试:从“估算”到“精准”  实际项目中,我们很难直接测量杂散电容的准确值,通常的做法是“先估算,后验证,再微调”:  1、先按3pF的经验值计算外接电容的初始值,焊上板子测试频率。  2、如果发现频率偏低,说明实际杂散电容比3pF大,需要减小外接电容值;如果频率偏高,就增大外接电容值。  3、反复微调,直到频率达到标称值。比如之前遇到过一个案例,晶振要求18pF负载电容,初始用了27pF的外接电容,结果频率偏低,判断杂散电容大概是5pF,换成22pF的电容后,频率就恢复正常了。  精 要 提 示  总之,杂散电容是PCB设计中最容易被忽略,却又影响巨大的因素。下次再遇到晶振异常,别着急换晶振,先查查是不是杂散电容在“搞鬼”。从设计阶段就重视它,再通过调试精准控制,就能让晶振稳定工作在标称频率上,避免很多不必要的麻烦。
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发布时间:2026-06-05 15:05 阅读量:723 继续阅读>>
罗姆参展<span style='color:red'>PC</span>IM Europe 2026 ~推动面向电动出行和工业领域的SiC功率技术发展~
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发布时间:2026-06-03 10:41 阅读量:939 继续阅读>>
核芯互联丨国产<span style='color:red'>PC</span>Ie 5.0线性重驱动器标杆之作 核芯互联CLRD320与TI DS320PR810深度对比
  在当前全球半导体供应链重构的大背景下,国产高性能信号调理芯片的技术突破与产业化进展备受关注。核芯互联(HexinHulian)推出的CLRD320八通道线性重驱动器,以对标TI DS320PR810的产品定位进入PCIe 5.0高端信号链路市场。本文将从电气性能、系统设计、应用场景等多个维度,对两款产品进行详尽的对比分析,为工程师及采购决策者提供客观、全面的技术参考。  图1 | CLRD320八通道线性重驱动器功能架构图  一、产品定位与技术架构  PCIe 5.0标准将单通道数据传输速率提升至32GT/s,信号完整性(Signal Integrity)成为系统设计中最严峻的挑战之一。高频信号在PCB走线、连接器和线缆中传输时会遭受严重的插入损耗(Insertion Loss),导致眼图闭合、误码率攀升。线性重驱动器(Linear Redriver)作为信号链路中的关键调理元件,通过连续时间线性均衡器(CTLE)对高频分量进行补偿,同时保持链路的线性特性,使下游接收端能够正确完成链路训练(Link Training),是PCIe 5.0系统设计中不可或缺的信号完整性解决方案。  核芯互联CLRD320是一款八通道多速率线性重驱动器,专为PCIe 5.0、CXL 2.0、UPI 2.0及速率高达32Gbps的其他高速接口设计。产品采用先进的模拟CMOS工艺,集成了双级连续时间线性均衡器与线性输出驱动器,每个通道独立运行。如上图所示,器件内部包含8路独立的信号通路,每路均配备双级CTLE和线性驱动器,同时集成了接收器检测、电源管理、SMBus/I2C接口、EEPROM控制器和数字核心等辅助功能模块,单路3.3V供电配合内部稳压器设计可有效抵抗板级电源噪声。  TI DS320PR810作为该细分领域的先发产品,自2022年发布以来已被多家服务器和存储厂商广泛采用,是PCIe 5.0线性重驱动器的事实标杆。两款产品在引脚定义、封装尺寸和基本功能架构上保持了高度一致,均为5.5mm×10mm WQFN-64封装,支持Pin Mode、SMBus/I2C从机模式和EEPROM自加载三种配置方式。  二、核心电气规格逐项对比  2.1 高速信号性能参数  技术解读:附加抖动是衡量重驱动器信号保真度的核心指标。CLRD320在附加随机抖动(70fs vs 75fs)和附加总抖动(1.3ps vs 1.5ps)两个关键参数上分别实现了约7%和13%的性能提升。在高密度服务器背板设计中,链路预算往往以毫分贝(mdB)和飞秒(fs)为单位进行精密计算,CLRD320更低的附加抖动意味着可为系统留下更大的抖动裕量(Jitter Margin),对于需要通过严格PCIe 5.0兼容性认证的产品而言,这一优势具有实质性的工程价值。  2.2 回波损耗与信号完整性  技术解读:回波损耗直接反映器件端口的阻抗匹配质量。CLRD320在16GHz频段的输入差分回波损耗达到-10dB,优于DS320PR810的-9dB;更为显著的是输入共模回波损耗指标,CLRD320在2.5~16GHz全频段内实现了-10dB至-13dB的性能,相比DS320PR810的-6dB至-9dB有大幅提升。优秀的共模回波损耗意味着器件对共模噪声的抑制能力更强,在多通道并行传输的x16配置中可有效降低通道间串扰和共模噪声向差模的转换。  2.3 功耗与电源特性  技术解读:正常工作模式下两款产品的有功功耗处于同一水平。CLRD320的待机功耗相对较高(RX检测等待功耗180mW vs 166mW,差异极小),在需要频繁进入低功耗状态的边缘计算场景中需纳入设计考量。但对于始终运行的数据中心服务器而言,待机功耗占比极小。CLRD320内部集成的高性能稳压器电源轨设计可有效抵抗板级电源噪声,确保均衡性能的一致性。  2.4 可靠性与环境适应性  三、系统设计与工程实现  3.1 控制接口与配置灵活性  CLRD320采用四级(4-Level)控制输入设计,通过1kΩ下拉、20kΩ下拉、浮空(Float)、1kΩ上拉四种状态实现配置。这种方案简化了外部电阻网络的设计复杂度,降低了BOM成本,对于仅需基础EQ配置的应用场景尤为友好。  DS320PR810采用五级(5-Level)控制输入,通过1kΩ/8.25kΩ/24.9kΩ/75kΩ下拉及浮空实现五级状态。五级设计提供了更多的配置粒度,但同时也增加了外部电阻的选型复杂度和成本。其MODE引脚L3和L4状态保留为TI内部测试模式,用户实际可用的配置级别为L0/L1/L2加浮空。  从工程实现角度看,CLRD320的四级控制输入方案在绝大多数服务器主板和加速卡应用中已完全够用,更简单的电阻配置降低了生产环节的贴片错误率,对大批量生产更为友好。  3.2 PCIe链路训练兼容性  两款产品均为协议无关(Protocol Agnostic)的线性重驱动器,这一设计哲学对PCIe 5.0系统至关重要。PCIe Gen3/4/5的链路训练协议要求Tx端发送10个Preset,Rx端通过7级CTLE和单抽头DFE寻找最优均衡组合。线性重驱动器不对信号进行非线性判决或再定时,而是将发射端Preset信号透明传递至接收端,使完整的端到端信道作为整体参与链路训练。  CLRD320的线性数据路径在32Gbps速率下保持了700mVpp的交流线性度范围,完全满足PCIe 5.0 Tx端800-1200mVpp输出摆幅的线性传输要求。自动接收器检测功能的状态机符合PCIe规范要求,支持上电检测、PERST#信号触发检测等多种检测模式。  3.3 配置时序与系统启动  CLRD320在系统启动速度方面展现出明显优势:EEPROM加载时间缩短33%(5ms vs 7.5ms),POR后首次SMBus访问时间缩短40%(30ms vs 50ms)。对于支持热插拔和需要快速枚举PCIe设备的服务器平台,更快的启动时序意味着更短的服务就绪时间和更高的系统可用性。  四、典型应用场景深度分析  4.1 服务器主板PCIe x16插槽信号延伸  应用描述  在机架式服务器和塔式服务器中,CPU Root Complex的PCIe x16信号需经过PCB走线、金手指连接器到达PCIe插槽。当走线距离超过PCIe 5.0规范建议的最大信道长度时,信号完整性会严重恶化。  方案部署:在CPU与PCIe插槽之间各放置两颗CLRD320(Tx和Rx方向各一颗,共16通道),可将有效信道延伸距离增加12-16英寸。低至70fs的附加抖动确保延伸后的链路仍能满足PCIe 5.0 Base Spec对总抖动的严格要求,为通过PCI-SIG兼容性认证提供充足的链路裕量。  4.2 HPC与GPU集群互联  应用描述  GPU集群和超级计算节点中,多个GPU通过PCIe Switch或直连方式互联,PCB走线距离较长且经过背板连接器。CXL 2.0协议在内存扩展和缓存一致性互联中的应用对信号完整性提出了更高要求。  方案部署:CLRD320支持PCIe 5.0和CXL 2.0双协议。在x16配置中,四颗CLRD320芯片即可实现全双工16通道信号调理。20ps超低偏差确保了x16链路中16条Lane的相位一致性,优异的共模回波损耗性能可有效抑制多通道并行传输时的共模噪声耦合。  4.3 存储区域网络与NVMe背板  应用描述  企业级存储阵列和NVMe SSD背板中,控制器需通过10-20英寸背板走线连接多达24个U.2/U.3 NVMe SSD插槽,高频插入损耗可达20dB以上@16GHz。  方案部署:CLRD320最大22dB的CTLE均衡能力完全覆盖此类应用场景的信道损耗预算。x24总线宽度的支持能力意味着三颗CLRD320即可覆盖24个NVMe SSD插槽。此外还支持SAS/SATA协议(激活缓冲模式),可在同一硬件平台上灵活支持三种SSD形态,实现通用背板(Universal Backplane)设计。  4.4 网络接口卡与硬件加速卡  应用描述  100G/200G/400G智能网卡(SmartNIC)和DPU通常采用PCIe 5.0 x16接口与主机CPU通信,板卡尺寸受限于FHHL/FHFL规格,PCB面积紧张。  方案部署:5.5mm×10mm紧凑WQFN封装适合空间受限的加速卡设计。通过EEPROM自加载模式,网卡上电后自动完成配置,无需外部MCU参与。Pin Mode模式下仅需几颗电阻即可完成功能配置,进一步降低设计复杂度。低至100ps的传播延迟对时序敏感的网络加速应用影响极小。  4.5 UPI 2.0处理器互联  应用描述  多路服务器(2P/4P/8P)中,CPU之间通过Intel UPI总线进行缓存一致性互联,UPI 2.0速率高达24GT/s,与PCIe 5.0处于同一信号速率量级。  方案部署:CLRD320明确支持UPI 2.0协议,可在多路服务器主板中部署于CPU之间的UPI链路。激活缓冲模式下禁用PCIe接收器检测,配置为通用带均衡缓冲器,完美适配UPI等非PCIe协议的传输需求。  五、核芯互联CLRD320核心竞争优势  六、选型建议与技术决策指南  对于正在评估PCIe 5.0线性重驱动器的系统设计师和采购决策者,以下场景化建议可供参考:  优先选择CLRD320的场景:  抖动敏感型设计:当链路预算紧张,需要通过PCI-SIG兼容性认证测试,或需要为长距离信道保留最大裕量时,CLRD320 70fs的附加抖动优势可转化为测试通过率的提升。  高频段损耗为主的信道:当PCB材料Df值较高或信道中含有较多连接器导致高频段反射严重时,CLRD320更优的回波损耗性能可改善整体信号质量。  国产替代/信创项目:在政府、金融、电信、能源等关键基础设施领域,有明确的国产化率要求或供应链安全考量时,CLRD320是可靠的国产替代方案。  快速启动需求:对于支持热插拔、需要快速枚举PCIe设备的服务器和存储平台,CLRD320更快的EEPROM加载和SMBus就绪时间可优化系统启动体验。  大批量成本敏感型应用:在年用量达数十万颗的大规模部署中,CLRD320的价格优势和简化的外围电路设计可带来可观的TCO降低。  建议综合评估的场景:  对待机功耗有极致要求的电池供电或边缘计算设备,需根据实际工作占空比计算总功耗影响。  工作环境温度长期接近125°C以上的极端场景,需评估结温裕量。  已有基于DS320PR810的成熟设计需要直接替代时,建议先进行SI仿真验证和兼容性测试,确保控制输入映射关系正确。  七、总结与展望  通过对核芯互联CLRD320与TI DS320PR810的深度技术对比,我们可以清晰地看到,国产PCIe 5.0线性重驱动器在核心技术指标上已达到甚至部分超越了国际标杆产品的水平。CLRD320在附加抖动、回波损耗、启动时序等关键性能参数上展现出明确的竞争优势,同时在供应链安全、技术支持响应速度和成本效益方面具备国产芯片的天然禀赋。  PCIe 5.0生态正处于快速扩张期,从服务器、存储到AI加速、网络基础设施,32Gbps高速信号调理的市场需求将持续增长。核芯互联CLRD320作为国内该细分领域的领先产品,不仅为工程师提供了高性能的信号完整性解决方案,更为中国半导体产业链在高端接口芯片领域的自主可控增添了重要一环。  对于正在规划或设计PCIe 5.0系统的工程师而言,CLRD320是一款值得认真评估的优秀选择。建议有需求的客户联系核芯互联获取评估板(EVB)、参考设计和SI仿真模型,通过实际测试验证其在目标应用场景中的表现。
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发布时间:2026-05-25 10:11 阅读量:797 继续阅读>>

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